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高級IC設計驗證工程師

大唐微電子技術有限公司
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薪資24-48萬元/月
工作性質(zhì): 全職 更新日期: 05-18
專業(yè)要求: 不限 學歷要求: 研究生/碩士
職稱要求: 不限 性別要求: 不限
年齡要求: 不限 經(jīng)驗要求: 5年以上
工作地區(qū): 北京 戶口要求: 不限
截止日期: 2025-08-02 外語要求: 不限
工資待遇: 24-48萬元/月 招聘人數(shù): 99人
其他福利:
五險一金 績效獎金 交通補助 餐補 補充醫(yī)療保險 節(jié)日福利
崗位職責:
??1.根據(jù)芯片設計規(guī)范完成驗證方案的制定,提取驗證功能點,進行覆蓋率分析;
??2.負責UVM驗證平臺搭建,搭建模塊級和系統(tǒng)級驗證環(huán)境,測試向量以及仿真模型的設計;
??3.制定并執(zhí)行驗證計劃,編寫驗證用例,編寫驗證腳本,完成回歸測試;
??4.負責芯片SOC集成驗證以及IP模塊驗證;
??5.參與前仿、后仿工作,協(xié)助回片后問題的定位分析。
??任職要求:
??1.?教育要求:研究生以上,電子科學與技術等相關專業(yè)。
??2.?工作經(jīng)驗:5年以上IC驗證經(jīng)驗,熟悉UVM驗證流程,搭建過UVM平臺者優(yōu)先。
??3.?知識技能:
??1)熟悉驗證方法學、UVM的各環(huán)節(jié)和流程;
??2)熟悉USB、I2C、SPI、UART、ISO7816、ISO14443、Ethernet、CAN、LCD、EMC等接口協(xié)議;
??3)熟悉ARM架構及AHB總線、有MCU系統(tǒng)及相關模塊驗證經(jīng)驗的優(yōu)先;
??4)精通或熟練掌握Verilog、System?Verilog、C、C++等語言;
??5)熟悉Python?/Perl/Makefile/Shell/Tcl之類的工具及腳本語言;
??6)熟練使用仿真及調(diào)試相關EDA工具,如VCS、Verdi等;
??4.?素質(zhì)要求:為人正直、愛崗敬業(yè)、吃苦耐勞、具有較強的團隊合作、協(xié)調(diào)能力。
公司主要從事微電子、軟件、接入、終端、通信應用與服務等領域的產(chǎn)品開發(fā)與銷售,是國內(nèi)具有自主知識產(chǎn)權的信息產(chǎn)業(yè)高科技骨干企業(yè)。秉承深厚的技術積淀,在十幾年的發(fā)展歷程中,大唐電信沉穩(wěn)務實,不斷超越,在信息產(chǎn)品與服務領域積極拓展,已形成以智能卡與SoC芯片為核心技術的芯片產(chǎn)業(yè)、以運營支撐系統(tǒng)為核心技術的軟件產(chǎn)業(yè)、以新一代通信接入及其相關業(yè)務為核心的通信設備產(chǎn)業(yè)、具有一流設計技術和團隊的通信終端產(chǎn)業(yè)、與微電子、軟件、通信終端協(xié)調(diào)發(fā)展的通信應用和服務產(chǎn)業(yè)。
聯(lián)系方式正在加載中......
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